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Marking：87321AIL；Package：SOIC；÷1, ÷2 Differential-TO-LVPECL Clock Generator FEATURES ?OnedifferentialLVPECLoutput ?OneCLK,nCLKinputpair ?CLK,nCLKpaircanacceptthefollowingdifferential inputlevels:LVPECL,LVDS,LVHSTL,SSTL,HCSL ?Maximumclockinputfrequency:700MHz ?Translatesanysingleendedinputsignal(LVCMOS,LVTTL, GTL)toLVPECLlevels | RENESASRenesas Technology Corp 瑞薩瑞薩科技有限公司 | RENESAS | ||
Marking：87321AIL；Package：SOIC；÷1, ÷2 Differential-TO-LVPECL Clock Generator FEATURES ?OnedifferentialLVPECLoutput ?OneCLK,nCLKinputpair ?CLK,nCLKpaircanacceptthefollowingdifferential inputlevels:LVPECL,LVDS,LVHSTL,SSTL,HCSL ?Maximumclockinputfrequency:700MHz ?Translatesanysingleendedinputsignal(LVCMOS,LVTTL, GTL)toLVPECLlevels | RENESASRenesas Technology Corp 瑞薩瑞薩科技有限公司 | RENESAS |
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